石英晶體振蕩器常用的輸出模式主要包含：TTL、CMOS、ECL、PECL、LVDS、Sine Wave。其中TTL、CMOS、ECL、PECL、LVDS均屬于方波，Sine Wave屬于正弦波。今天給大家解說(shuō)到的是晶體振蕩器中的三態(tài)輸出技能。

大多數(shù)數(shù)字體系運(yùn)用由兩個(gè)狀況等級(jí)0和1表明的二進(jìn)制數(shù)體系。在一些特別應(yīng)用中，需求第三狀況（Hi阻抗輸出）。TTL，HCMOS或HCMOS石英晶體振蕩器供給三態(tài)輸出或三態(tài)啟用/禁用功用。其常見(jiàn)應(yīng)用包含自動(dòng)測(cè)驗(yàn)，總線數(shù)據(jù)傳輸。

這三種狀況是低，高和高阻抗（HiZ或浮動(dòng)）。高阻抗?fàn)顩r的輸岀體現(xiàn)得如同它與電路斷開(kāi)，除了可能有小的漏電流。三態(tài)器材具有使能/禁止輸入，一般在簡(jiǎn)直任何封裝的引腳1上。當(dāng)使能為高電平或懸空時(shí)，器材振蕩（輸出高電平和低電平），當(dāng)引腳1接地（邏輯“0”）時(shí)，器材進(jìn)入高阻態(tài)。

總線是一組通用的電線，一般用于數(shù)據(jù)傳輸。三態(tài)總線有幾個(gè)三態(tài)輸出銜接在一起。經(jīng)過(guò)控制電路，除了一個(gè)總線上的一切設(shè)備都具有高阻抗?fàn)顩r的輸出。其余器材使能，驅(qū)動(dòng)高低輸出總線。

三態(tài)功用的其他應(yīng)用是用于自動(dòng)測(cè)驗(yàn)設(shè)備（ATE）。幾個(gè)有源晶振晶體振蕩器的輸出銜接在一起。對(duì)于控制電路，除了振蕩器外，一切振蕩器都具有高阻抗?fàn)顩r的輸出。選擇的振蕩器將從計(jì)數(shù)器讀出其頻率。

在三態(tài)函數(shù)生效之前總會(huì)有一些推遲。此轉(zhuǎn)化發(fā)生在兩個(gè)轉(zhuǎn)化（禁用和啟用時(shí)）。從低電平開(kāi)端的三態(tài)輸出禁止時(shí)間是tPLZ，三態(tài)到低電平的輸出使能時(shí)間是tPZL。

CMOS

上升和下降時(shí)間CMOS技能的上升和下降時(shí)間取決于其速度（CMOS、HCMOS、ACMOS、 BICMOS），石英晶體振蕩的電源電壓，負(fù)載電容和負(fù)載裝備。CMOS 40000列的典型上升和下降時(shí)間為30ns， HCMOS為6ns，而ACMOS（ HCMOS/TTL兼容）的zui大上升和下降時(shí)間為3ns。典型的上升和下降時(shí)間在其波形水平的10％至90％之間測(cè)量。

ACMOS輸出停止技能

因?yàn)锳CMOS（ HCMOS/TL兼容）器材的快速轉(zhuǎn)化時(shí)間，在測(cè)驗(yàn)或測(cè)量石英晶體振蕩器電氣功能特性時(shí)有必要運(yùn)用正確的端接技能。端接一般用于解決電壓反射問(wèn)題，這實(shí)質(zhì)上導(dǎo)致時(shí)鐘波形中的步驟以及過(guò)沖和下沖。這可能導(dǎo)致數(shù)據(jù)的錯(cuò)誤時(shí)鐘，以及更高的EM和體系噪聲。

因?yàn)?a href='http://aivideostyle.cn/news/767.html' target='_blank' class='key_tag'>PCB板上的線長(zhǎng)度及其負(fù)載裝備，還需求端接。有三種停止時(shí)鐘軌跡的通用辦法，行將器材的輸出阻抗與線路阻抗相匹配的過(guò)程：

辦法1：串聯(lián)終端在串聯(lián)終端中，阻尼電阻靠近時(shí)鐘信號(hào)源放置。Rs的值有必要滿足以下要求:Rs≥ZT-Ro

辦法2：上拉/下拉電阻在上拉/下拉終端中，組合等效于跡線的特征阻抗。這可能是較干凈的，而且不會(huì)發(fā)生任何反射，也會(huì)降低EMI。